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精度可重构的近似加法器设计

Design of Approximate Adder With Reconfigurable Accuracy

Aalelai Vendhan · Syed Ershad Ahmed · S. Gurunarayanan · IEEE Access · 2025年1月

加法器等算术电路是图像处理应用的基础组件。本文提出分段技术设计三值近似加法器,将整个加法器链分段以降低延迟。针对需要可调精度的应用,采用分治法在分段近似加法器中融入重构技术,动态优化精度实现高效计算。提出算法计算N-trit精度可重构加法器的准确度和硬件复杂度。所提6-trit加法器与文献最佳设计相比功耗降低63%、延迟降低69%。通过重构方法逐步提升精度,达到精确加法器精度的同时改善功率延迟积。图像混合应用验证了所提加法器性能。

解读: 该可重构加法器技术可应用于阳光电源FPGA和DSP芯片设计。阳光储能变流器和逆变器的数字控制芯片需要高效算术运算单元,该近似计算技术可降低功耗和延迟。阳光可在ST系列产品的边缘AI加速器中采用该技术,优化图像识别和数据处理算法,提升控制器计算效率,降低芯片成本和功耗。...